2021

控制单元的设计与实现

2020

Cache同步机制的设计实现和测试
关于指令译码级(ID stage)的设计决策
组相联cache设计、实现与测试
关于Cache设计的思考
总线控制器设计
关于中断和io控制器
cpu内部只采用一个时钟，对于不同速度的组件将采用clock enabler
下一步的计划
读完LCC完整源代码
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